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Stage FPGA/ASIC — Contremesures SCA sur IP cryptographique
Job summary
Une société de défense internationale recherche un(e) stagiaire pour intégrer son équipe en conception FPGA / ASIC. Le stagiaire étudiera l’implémentation de contre-mesures sur des systèmes de cryptographie, en se concentrant sur les vulnérabilités des architectures IP. Les candidats doivent être en dernière année d'une formation en Électronique et posséder des connaissances en VHDL ou Verilog. Un bon niveau d'anglais est requis. Durée du stage : 6 mois, début à partir de février 2026.
Qualifications
- Connaissances des mécanismes de contre-mesures contre les attaques par canal auxiliaire.
- Compréhension du codage RTL et du processus de validation en simulation.
- Des connaissances en cryptographie seraient un plus.
Responsibilities
- Étudier les mécanismes de contre-mesures existants.
- Implémenter des mécanismes de contre-mesures sur une IP existante.
- Tester l’efficacité des contre-mesures sur un banc d’évaluation.
Skills
Education
* The salary benchmark is based on the target salaries of market leaders in their relevant sectors. It is intended to serve as a guide to help Premium Members assess open positions and to help in salary negotiations. The salary benchmark is not provided directly by the company, which could be significantly higher or lower.