Ingénieur

CNRS; Grenoble; Sur place; EUR 40 000 - 60 000; Plein temps

Résumé du poste

Un laboratoire de recherche recherche un ingénieur pour le développement d'architectures de processeurs basées sur des FPGA et des ASIC. Le candidat idéal doit avoir un diplôme en microélectronique ou nanoélectronique et des compétences en conception de circuits numériques et langages de programmation. Le poste est basé à Grenoble et propose un contrat complet de 15 mois, avec une rémunération de 3 143 à 3 403 € brut mensuel selon l'expérience.

Qualifications

• Titre d'ingénieur requis en microélectronique/nanoélectronique.
• Compétences dans la conception de circuits numériques.
• Bonne connaissance des langages de programmation comme Python ou Matlab.

Responsabilités

• Développer une plateforme de test FPGA.
• Participer au développement d'une architecture de processeur sécurisée.
• Modélisation d'une mémoire nécessitant simulations électriques.

Connaissances

Conception de circuits numériques

Langages de programmation (Python, Matlab)

Conception de dispositifs

Formation

Diplôme d'ingénieur en microélectronique et/ou nanoélectronique

Description du poste

H/F ingénieur: Développement d'architectures de processeurs au niveau du système, basées sur des FPGA et des ASIC

Date Limite Candidature : jeudi 5 février 2026 23:59:00 heure de Paris

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Informations générales

Intitulé de l'offre : H/F ingénieur: Développement d'architectures de processeurs au niveau du système, basées sur des FPGA et des ASIC
Référence : UMR8191-GREDIP-011
Nombre de Postes : 1
Lieu de travail : GRENOBLE
Date de publication : jeudi 15 janvier 2026
Type de contrat : IT en contrat CDD
Durée du contrat : 15 mois
Date d'embauche prévue : 1 avril 2026
Quotité de travail : Complet
Rémunération : Entre 3 143€ et 3 403€ brut mensuel selon expérience
Niveau d'études souhaité : BAC+5
Expérience souhaitée : 1 à 4 années
BAP : C - Sciences de l'Ingénieur et instrumentation scientifique
Emploi type : Experte electronicienne ou expert electronicien

Missions

• Développer une plateforme de test FPGA intégrant des mémoires MRAM du marché pour valider une architecture processeur complète de haut niveau.
• Participer au développement d'une architecture de processeur sécurisée dans le cadre d'attaques de fautes.
• Développer un modèle de mémoire MRAM basé sur les dernières générations de Magnetic Tunnel Junction.
• Assurer la modélisation d'une mémoire nécessitant simulations électriques et caractérisations.

Activités

• Conception numérique
• Synthèse et simulation FPGA
• Conception d'une plate-forme de test
• Processus de validation

Compétences

Le candidat doit être titulaire d'un diplôme d'ingénieur en microélectronique et/ou nanoélectronique, avec des compétences dans les domaines de la conception de circuits numériques et une bonne connaissance des langages de programmation (Python, Matlab, etc.). Des compétences en matière de conception de dispositifs seraient appréciées.

Contexte de travail

Le travail s'effectuera au sein du laboratoire Spintec au centre du CEA de Grenoble. Le laboratoire Spintec, spécialisé dans le domaine de la spintronique et des composants MRAM, est composé de 13 équipes de recherche réparties en 2 grands groupes. Ce poste est à pourvoir dans l'équipe de conception de circuits intégrés, composé de 4 permanents et environ 5 étudiants. Ce poste demande donc un travail en équipe.

Le contrat sera financé par l'ANR dans le cadre du projet ANR « SCREAM » sélectionné en 2024. Les travaux seront réalisés en collaboration entre le LIRMM (UMR 5506 Université de Montpellier / CNRS), SPINTEC (UMR 8191 CEA / CNRS / Université Grenoble-Alpes / Grenoble INP) et EMSE (Ecole des Mines de Saint Etienne).