Digital Verification Engineer

Inova Semiconductors GmbH; München; Hybrid; EUR 50.000 - 80.000; Vollzeit

Zusammenfassung

Ein innovatives Unternehmen sucht einen engagierten Verifikationsingenieur, der für den Entwurf und die Implementierung von Testbenches für moderne APX Produkte verantwortlich ist. In dieser spannenden Rolle arbeiten Sie eng mit einem hochmotivierten Team zusammen und profitieren von einer umfassenden Einarbeitung in die neuesten Technologien. Sie werden an Systemlevel Simulationen und der Integration von Referenzmodellen beteiligt sein, während Sie Ihre Fähigkeiten in SystemVerilog, SystemC und UVM weiterentwickeln. Mit der Möglichkeit, im Homeoffice zu arbeiten, und attraktiven Benefits wie betrieblicher Altersvorsorge und flexiblen Arbeitszeiten bietet diese Position eine hervorragende Gelegenheit, Ihre Karriere voranzutreiben.

Leistungen

30 Tage Urlaub

Betriebliche Altersvorsorge

Fahrrad-Leasing

Regelmäßige Weiterbildungsangebote

Flache Hierarchien

Corporate benefits

Freizeit-Fußballtreff

Bouldern

Qualifikationen

• Mindestens 3 Jahre Erfahrung in digitaler Verifikation mit SystemVerilog, SystemC und UVM.
• Solide Kenntnisse in Linux und Skriptsprachen wie Python.

Aufgaben

• Entwurf und Implementierung von Testbenches für neue APX Produkte.
• Integration von Referenz- und VIP-Modellen in Testbenches.

Kenntnisse

SystemVerilog

SystemC

UVM

C++

Python

Analytische Fähigkeiten

Kommunikationsfähigkeiten in Englisch und Deutsch

Ausbildung

Abgeschlossenes Studium der Elektrotechnik/Informatik

Tools

Linux

Jobbeschreibung

Verantwortlichkeiten

1. Verantwortlich für den Entwurf und der Implementierung von Testbenches für Module und Funktionsgruppen unserer neuen APX Produkte mit modernen Hardwarebeschreibungssprachen wie SystemVerilog und SystemC
2. Mitarbeit beim Entwurf und der Implementierung von SystemVerilog UVM und SystemC Testbenches für Systemlevel Simulationen und Virtual Prototype Simulationen
3. Integration von Referenz Modellen und VIP Modellen in Testbenches
4. Verantwortlich für das Ausführen von Regressionsimulationen und die Auswertung von Simulationsergebnissen
5. Mitarbeit beim Erstellen und Pflegen von Verifikationsplänen
6. Enge Zusammenarbeit mit dem Designteam
7. Unterstützung bei der Inbetriebnahme neuer Bausteine in unserer Laborumgebung

Was wir bieten

1. Eine umfangreiche Einarbeitung in unsere Technologien und Produkte
2. Regelmäßige Weiterbildungsangebote sind selbstverständlich
3. Flache Hierarchien mit schnellen Entscheidungsprozessen
4. Förderung von eigenen Ideen und eine unbürokratische Umsetzung
5. Ein hochmotiviertes Team, das sich auf jeden neuen engagierten Mitarbeiter freut
6. Sie arbeiten aus unseren Büroräumen in München, die Möglichkeit für Homeoffice besteht
7. Ein attraktives Festgehalt sowie 30 Tage Urlaub sind selbstverständlich
8. Betriebliche Altersvorsorge sowie die Möglichkeit des Fahrrad-Leasing
9. Unser Team freut sich auf Sie als neuen Mitspieler/in im firmeninternen Freizeit-Fußballtreff oder auch zum Bouldern
10. Corporate benefits

Ihr Profil

1. Sie haben ein abgeschlossenes Studium der Elektrotechnik/Informatik oder einer vergleichbaren Fachrichtung
2. Mindestens 3 Jahre Erfahrung in der digitalen Verifikation (SystemVerilog / SystemC / UVM)
3. Erfahrung im digitalen Design sind von Vorteil
4. Erfahrung in der constrained random und Assertion basierten Verifikation
5. Erfahrung in objektorientierter Programmierung mit C++ sind wünschenswert
6. Kenntnisse über gängige Videoschnittstellen wie LVDS, HDMI, DSI, CSI oder DisplayPort sind von Vorteil, ebenso wie Datenschnittstellen wie PCI und AXI
7. Gute analytische Fähigkeiten
8. Sie haben solide Linux-Kenntnisse und Erfahrungen in Skriptsprachen (z. B. Python)
9. Teamorientierte Arbeitsweise
10. Sie haben gute Kommunikationsfähigkeiten in Englisch und Deutsch

Lust auf mehr?

Dann bewerben Sie sich noch heute. Wir freuen uns sehr auf Ihre Bewerbung und würden uns freuen sie bald in unserem Team begrüßen zu dürfen.

Inova Semiconductors GmbH
Human Resources
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