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Ingénieur Conception RTL ASIC
Job summary
Une entreprise spécialisée en ingénierie recherche un Ingénieur en conception RTL ASIC pour participer au développement de circuits intégrés numériques complexes. Le candidat idéal possède une formation Bac+5 en microélectronique et une solide expérience en conception RTL pour ASICs. La maîtrise des langages VHDL, Verilog, et de l'architecture RISC-V est requise. Ce poste offre une opportunité de travailler au sein d'une structure dynamique et innovante située à Grenoble.
Qualifications
- Expérience en conception RTL pour ASICs (pas FPGA).
- Bonne maîtrise des langages de description matérielle.
- Compétences solides en architecture matérielle, notamment RISC-V.
Responsibilities
- Développement de circuits intégrés numériques complexes.
- Conception RTL en VHDL, Verilog et SystemVerilog.
- Vérification fonctionnelle à l'aide des outils QuestaSim ou Xcelium.
Skills
Education
Tools
Coris Innovation est une entreprise spécialisée dans les métiers de l'ingénierie système et des processus industriels.
Fondée en 2015, notre société a été imaginée selon un principe clairement défini : insérer le consulting dans une relation durable et de proximité en assurant la satisfaction de nos partenaires, de nos consultants et de notre structure.
Cette conception du conseil en ingénierie est aujourd'hui partagée par une centaine de collaborateurs répartis au sein de 5 agences entre la Suisse et la France (Annecy, Bourges, Grenoble et Lyon) qui accompagnent au quotidien nos clients industriels dans leurs défis d'innovation, de Recherche & Développement et de production.
Vous souhaitez prendre part à l'aventure et rejoindre une structure en pleine croissance et qui se donne les moyens de respecter ses engagements auprès de ses collaborateurs et de ses clients ? C'est par ici !
Description du poste :
- En tant qu'Ingénieur en conception RTL ASIC, vous participerez au développement de circuits intégrés numériques complexes, de la spécification à l'intégration finale. Vous interviendrez notamment sur :
- La conception RTL en VHDL, Verilog et SystemVerilog
- L'implémentation de processeurs de type RISC-V, en langage C ou assembleur
- La vérification fonctionnelle (simulation RTL ou backannotée) à l'aide des outils QuestaSim ou Xcelium
- La synthèse logique avec Design Compiler (Synopsys) ou Genus (Cadence)
- Le placement & routage (P&R) avec l'outil Innovus (Cadence)
- Formation Bac+5 / Ingénieur en microélectronique, électronique, ou équivalent
- Expérience en conception RTL pour ASICs (pas FPGA)
- Bonne maîtrise des langages de description matérielle (VHDL / Verilog / SystemVerilog)
- Compétences solides en architecture matérielle, notamment RISC-V
- Maîtrise des outils de simulation, de synthèse et de P&R
- Capacité à travailler en équipe, rigueur, autonomie et curiosité technique
- Langages : VHDL, Verilog, SystemVerilog, C, Assembleur
- Processeur : Architecture RISC-V
- Outils de simulation : QuestaSim, Xcelium
- Outils de synthèse : Design Compiler, Genus
- Outils de P&R : Innovus
* The salary benchmark is based on the target salaries of market leaders in their relevant sectors. It is intended to serve as a guide to help Premium Members assess open positions and to help in salary negotiations. The salary benchmark is not provided directly by the company, which could be significantly higher or lower.
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