Senior Front-End ASIC RTL Engineer

Capgemini Engineering

Montbonnot-Saint-Martin

Sur place

EUR 90 000 - 125 000

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Activités sociales et culturelles

Résumé du poste

Capgemini Engineering, leader mondial des services d’ingénierie, recherche un Expert Design ASIC Front-End pour rejoindre une équipe d’ingénieurs et d’architectes dynamique travaillant sur les technologies de semi-conducteurs les plus avancées.

Vous concevrez, développerez et déboguerez des IP numériques/mixtes dans des projets SoC, intégrerez des IPs, et collaborerez étroitement avec les équipes VLSI pour assurer la qualité et le respect des normes DFT, CDC, RDC et UPF.

Qualifications

  • Expérience d'au moins 15 ans en conception et vérification d'IP numériques ou mixtes.
  • Intégration d’IP au niveau SoC - partition ou FPGA.

Responsabilités

  • Étudier et spécifier des IP numériques ou mixtes numériques-analogiques utilisés dans des composants ASIC.
  • Concevoir ou adapter des IP en RTL (Verilog/SystemVerilog/VHDL) tout en respectant les règles DFT, CDC, RDC, Lint, UPF.
  • Intégrer les IPs dans une partition ou au niveau du SoC.
  • Intervenir avec les équipes VLSI (vérification, intégration, physical design, S/W-F/W, Product & Test Engineering) pour assurer la qualité du projet.

Connaissances

RTL design
ASIC Front-End
Verilog/SystemVerilog
VHDL
SoC integration
IP integration
CPU ISA ARM/MIPS/RISCV
DFT/CDC/Lint/UPF
IP verification
Digital/analog IPs

Outils

Cadence
Synopsys
Mentor Graphics
Vivado
ModelSim

Description du poste

Capgemini Engineering, leader mondial des services d’ingénierie, recherche un Expert Design ASIC Front-End pour rejoindre une équipe d’ingénieurs et d’architectes dynamique travaillant sur les technologies de semi-conducteurs les plus avancées.

Vous concevrez, développerez et déboguerez des IP numériques/mixtes dans des projets SoC, intégrerez des IPs, et collaborerez étroitement avec les équipes VLSI pour assurer la qualité et le respect des normes DFT, CDC, RDC et UPF.

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