Ingénieur Vérification SoC Sécurité — Threats & RTL

Randstad Digital FR

Valbonne

Hybride

EUR 42 000 - 65 000

Plein temps

14 jours+

Recevez plus de réponses des employeurs

Envoyez un CV adapté au poste en quelques minutes.

Avantages offerts par ce poste

Télétravail partiel
Formation continue
Udemy Business pour tous les employés
Prime decooptation
Handi-accueillante

Résumé du poste

Randstad Digital FR recherche un ingénieur vérification SoC/ASIC avec une appétence pour la sécurité matérielle. Vous travaillez en collaboration avec les Architectes Sécurité, Design Engineers et Leads Vérification pour définir les plans de vérification et maintenir des environnements de test en SystemVerilog / UVM.

Le poste implique la vérification des fonctionnalités clés (Secure Boot, TrustZone, gestion des clés) et la supervision des tests orientés threats, avec analyse et sign-off des

Qualifications

  • Expérience en vérification SoC/ASIC/RTL avec focus sur la sécurité matérielle.
  • Diplôme d'Ingénieur ou Master 2 en Électronique, Microélectronique ou Systèmes Embarqués exigé.

Responsabilités

  • Définir la stratégie de vérification sécurité et les modèles de couverture au niveau cluster et SoC.
  • Développer et maintenir des environnements de test robustes en SystemVerilog / UVM.
  • Vérifier les fonctionnalités clés: Secure Boot, contrôle d'accès et isolation de domaines.
  • Réaliser des tests orientés Threats et erreurs (constrained-random, injection d'erreurs).
  • Analyser les anomalies RTL, évaluer la couverture et assurer la traçabilité jusqu'au sign-off.

Connaissances

vérification SoC/ASIC/RTL
sécurité matérielle
SystemVerilog
UVM
plan de tests sécurité

Formation

Diplôme d'Ingénieur ou Master 2 en Électronique

Outils

SystemVerilog
UVM

Description du poste

Randstad Digital FR recherche un ingénieur vérification SoC/ASIC avec une appétence pour la sécurité matérielle. Vous travaillez en collaboration avec les Architectes Sécurité, Design Engineers et Leads Vérification pour définir les plans de vérification et maintenir des environnements de test en SystemVerilog / UVM.

Le poste implique la vérification des fonctionnalités clés (Secure Boot, TrustZone, gestion des clés) et la supervision des tests orientés threats, avec analyse et sign-off des

Obtenez votre examen gratuit et confidentiel de votre CV.
ou faites glisser et déposez votre fichier ici.
Similar jobs

Postes similaires à comparer

ingénieur vérification soc – spécialiste sécurité hw (f/h)
ingénieur vérification soc – spécialiste sécurité hw (f/h)

Randstad Digital FR • Valbonne

Hybride
EUR 42 000 - 65 000
Télétravail partiel
Formation continue
Udemy Business pour tous les employés
+2
SoC Verification Architect & Team Lead
SoC Verification Architect & Team Lead

ordde.io | Ecosystem for Recruiters • Grenoble

Sur place
EUR 70 000 - 100 000
Ingénieur Vérification UVM Sénior SoC/ASIC – SystemVerilog
Ingénieur Vérification UVM Sénior SoC/ASIC – SystemVerilog

Elsys Design • Valbonne

Sur place
EUR 40 000 - 60 000
Ingénieur Vérification ASIC R&D – UVM, SoC | Télétravail 60%
Ingénieur Vérification ASIC R&D – UVM, SoC | Télétravail 60%

Eviden • Les Clayes-sous-Bois

Hybride
EUR 50 000 - 70 000
Télétravail possible
Plan de formation
Événements en lieu privatisé
+1
Ingénieur Vérification RTL Senior | UVM & SystemVerilog
Ingénieur Vérification RTL Senior | UVM & SystemVerilog

CELAD • France

Sur place
EUR 70 000 - 90 000
RTT 15 jours
Participation bénéfices
Indemnité déplacement
+6
SoC Design Verification Engineer – RTL/UVM & Python
SoC Design Verification Engineer – RTL/UVM & Python

France Travail • Biot

Sur place
EUR 55 000 - 70 000
Ingénieur Vérification RTL Senior – SystemVerilog UVM
Ingénieur Vérification RTL Senior – SystemVerilog UVM

CEA • Grenoble

Hybride
EUR 45 000 - 65 000
Télétravail possible
Formations professionnelles
Équilibre vie pro/perso
+2
Ingénieur Design ASIC RTL pour SoC & Performance
Ingénieur Design ASIC RTL pour SoC & Performance

CELAD • Rousset-Serre-Ponçon

Sur place
EUR 55 000 - 75 000
Ingénieur Vérification Numérique Senior — IP/SOC
Ingénieur Vérification Numérique Senior — IP/SOC

STMicroelectronics France • Grenoble

Sur place
EUR 90 000 - 120 000
Ingénieur Vérification UVM pour SoC/ASIC FPGA (Remote)
Ingénieur Vérification UVM pour SoC/ASIC FPGA (Remote)

Elsys Design • Provence-Alpes-Côte d'Azur

Sur place
EUR 45 000 - 65 000