Ingénieur DFT ASIC — Design for Test & RTL

ELSYS Design SA

Valbonne

On-site

EUR 60,000 - 85,000

Full time

5 days ago
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RTT 10 jours / an
Repas ou Titre-restaurant
Mutuelle santé famille
Compte Epargne Temps
Participation et Intéressement
Prime de cooptation
Prime de vacances
Prime Transport 200 € net/an et 50 €/

Job summary

ELSYS Design recherche un ingénieur spécialisé en DFT pour intégrer et optimiser les tests au sein du flux RTL/ASIC. Vous définirez les spécifications DFT, travaillerez avec les équipes de conception et de vérification, et générerez des patterns de test robustes.

Vous mettrez en place des chaînes de scan, ATPG et BIST, et vous réaliserez des vérifications approfondies afin d'assurer une fiabilité maximale du produit final. Anglais technique requis et collaboration transversale assurée.

Qualifications

  • Maîtrise des langages RTL (VHDL/Verilog/SystemVerilog).
  • Connaissance du flow de développement d'un ASIC.
  • Anglais technique avancé.

Responsibilities

  • Contribuer à la définition et à l'architecture DFT.
  • Intégrer et optimiser la DFT dans le design RTL (RTL/ASIC).
  • Générer des patterns de test et concevoir des chaînes de scan, ATPG et BIST.
  • Réaliser des vérifications exhaustives des mécanismes de test et garantir leur robustesse.
  • Proposer et mettre en œuvre des tests pertinents pour assurer la qualité finale de l'ASIC.

Skills

VHDL
Verilog
SystemVerilog
ASIC开发流程

Education

Diplôme d'ingénieur en microélectronique

Tools

Tessent DFTAdvisor
Mentor Fastscan

Job description

ELSYS Design recherche un ingénieur spécialisé en DFT pour intégrer et optimiser les tests au sein du flux RTL/ASIC. Vous définirez les spécifications DFT, travaillerez avec les équipes de conception et de vérification, et générerez des patterns de test robustes.

Vous mettrez en place des chaînes de scan, ATPG et BIST, et vous réaliserez des vérifications approfondies afin d'assurer une fiabilité maximale du produit final. Anglais technique requis et collaboration transversale assurée.

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