Analog IC Engineer (FinFET) — Low-Power Building Blocks

Move Silicon

Lombardia

Híbrido

EUR 32 000 - 42 000

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Smart working ibrido
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Mentorship e formazione EDA

Resumo da oferta

Move Silicon cerca un/una Analog IC Engineer per affiancare il team nella progettazione di circuiti analogici su nodi FinFET avanzati. Obiettivo: realizzare building-block a bassissima potenza e alta velocità, ottimizzati per layout-aware e variabilità dei processi.

Richiede esperienza con Cadence Virtuoso/Spectre, analisi di rumore e mismatch, simulazioni transistor-level e co-simulazioni AMS. Lavoro in team con layout e senior designer, con smart working ibrido nelle sedi di Milano e Lucca.

Qualificações

  • Laurea magistrale in Ingegneria Elettronica o affini (con tesi su circuiti analogici).
  • Esperienza su nodi FinFET o FD-SOI avanzati.
  • Buona conoscenza Cadence Virtuoso/Spectre e modellistica FinFET.
  • Fondamenti di op-amp, reference e comparatori a bassa potenza.
  • Capacità di analisi di rumore, mismatch e PVT.
  • Attitudine al problem-solving e lavoro di squadra.

Responsabilidades

  • Progettazione e simulazione transistor-level di circuiti analogici su PDK FinFET (BSIM-CMG, PSP-X).
  • Analisi di rumore, consumo, mismatch e layout parasitic-aware con Cadence Virtuoso/Spectre e EM/RC extractor.
  • Co-simulazioni AMS (Spectre-AMS/Verilog-AMS) per integrare blocchi misti analogico-digitali.
  • Collaborazione con layout engineer per floor-plan FinFET-friendly.
  • Esecuzione di corner, Monte Carlo e PVT sweep su server farm e ottimizzazione di biasing.
  • Preparazione di documentazione tecnica e partecipazione a design review.

Conhecimentos

Esperienza FinFET
Cadence Virtuoso/Spectre
Analisi rumore/mismatch
Low-power design
Biasing
Lavoro di squadra

Formação académica

Laurea magistrale in Ingegneria Elettronica

Ferramentas

Cadence Tools
Spectre APS/XPS
EM/RC extraction

Descrição da oferta de emprego

Move Silicon cerca un/una Analog IC Engineer per affiancare il team nella progettazione di circuiti analogici su nodi FinFET avanzati. Obiettivo: realizzare building-block a bassissima potenza e alta velocità, ottimizzati per layout-aware e variabilità dei processi.

Richiede esperienza con Cadence Virtuoso/Spectre, analisi di rumore e mismatch, simulazioni transistor-level e co-simulazioni AMS. Lavoro in team con layout e senior designer, con smart working ibrido nelle sedi di Milano e Lucca.

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