Senior FPGA- und SoC-Entwicklungsingenieur

Noser Engineering AG

Bern

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CHF 110 000 - 150 000

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Résumé du poste

Die Noser Engineering AG sucht einen Senior FPGA-Entwicklungsingenieur, der an medizinischen und industriellen Embedded-Systemen arbeitet. Sie verantworten Architektur, Design, Implementierung, Simulation und Verifikation komplexer FPGA-/SoC-Lösungen sowie die Integration in übergeordnete Systeme.

Sie bringen mehrjährige Erfahrung mit AMD/Xilinx- und/oder Intel-Plattformen, VHDL/SystemVerilog, sowie fundierte Kenntnisse in RTL-Design, Timing-Analyse und High-Speed-Schnittstellen mit.

Qualifications

  • Mehrjährige praktische Erfahrung in der FPGA-/SoC-Entwicklung.
  • Erfahrung mit AMD/Xilinx- und/oder Intel-Plattformen.
  • Gute Kenntnisse in VHDL oder SystemVerilog.
  • Vertraut mit Vivado/Quartus/Questa und RTL-Design.
  • Kenntnisse in High-Speed-Schnittstellen wie PCIe, Ethernet oder DDR.

Responsabilités

  • Architektur, Design, Implementierung, Simulation und Verifikation komplexer FPGA-/SoC-Lösungen.
  • Entwicklung wartbarer RTL-Designs und selbstprüfender Testbenches.
  • Definition von Timing Constraints; Timing-, Ressourcen- und Performance-Analysen.
  • Integration in Embedded-Systeme; Inbetriebnahme und Debugging auf Zielhardware.
  • Dokumentation von Architektur, Design und Verifikation; Kundenberatung.

Connaissances

FPGA-Entwicklungskenntnisse
SoC-Design
VHDL/SystemVerilog
RTL-Design
Timing-Analysen
Vivado
Quartus
Questa
PCIe-Interfaces
Python/Testautomation
Englisch
Deutsch

Formation

Elektrotechnik/Informatik/Computer Engineering

Outils

AMD Vivado
Intel Quartus
Siemens Questa

Description du poste

Die Noser Engineering AG sucht einen Senior FPGA-Entwicklungsingenieur, der an medizinischen und industriellen Embedded-Systemen arbeitet. Sie verantworten Architektur, Design, Implementierung, Simulation und Verifikation komplexer FPGA-/SoC-Lösungen sowie die Integration in übergeordnete Systeme.

Sie bringen mehrjährige Erfahrung mit AMD/Xilinx- und/oder Intel-Plattformen, VHDL/SystemVerilog, sowie fundierte Kenntnisse in RTL-Design, Timing-Analyse und High-Speed-Schnittstellen mit.

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